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1，如何让quartusII建立自己的库

一般编译仿真过的verilog法度榜样随便放在哪只要将文件参加到工程中就可以直接用了

如何让quartusII建立自己的库

2，请教soliworks flow simulation工程数据库如何建

在选择材料界面点 创建,进入材料库以后,在空白位置点右键,创建新材料
好的，谢谢，去先试一下

请教soliworks flow simulation工程数据库如何建

3，集成电路仿真库和工艺库是如何生成的

集成电路库和仿真库就是由四个基本逻辑电路的父类和它派生的子类按照你设计的电路的数据库文件中的数据的逻辑顺序联接排列所形成的一个逻辑数据库文件。

集成电路仿真库和工艺库是如何生成的

4，电路仿真软件c语言C十十编程数据库

定义电路仿真，顾名思义就是设计好的电路图通过仿真软件进行实时模拟，模拟出实际功能，然后通过其分析改进，从而实现电路的优化设计。是EDA（电子设计自动化）的一部分。电路仿真软件现在比较常用的电路仿真软件有：Multisim系列，Cadence等。Multisim Multisim是美国国家仪器（NI）有限公司推出的以Windows为基础的仿真工具，适用于板级的模拟/数字电路板的设计工作。它包含了电路原理图的图形输入、电路硬件描述语言输入方式，具有丰富的仿真分析能力。图形界面整个操作界面就像一个电子实验工作台，绘制电路所需的元器件和仿真所需的测试仪器均可直接拖放到屏幕上，轻点鼠标可用导线将它们连接起来，软件仪器的控制面板和操作方式都与实物相似，测量数据、波形和特性曲线如同在真实仪器上看到的；元器件提供了世界主流元件提供商的超过17000多种元件，同时能方便的对元件各种参数进行编辑修改，能利用模型生成器以及代码模式创建模型等功能，创建自己的元器件。仿真能力以SPICE3F5和Xspice的内核作为仿真的引擎，通过Electronic workbench 带有的增强设计功能将数字和混合模式的仿真性能进行优化。包括SPICE仿真、RF仿真、MCU仿真、VHDL仿真、电路向导等功能。
不懂这些个再看看别人怎么说的。

5，如何仿真IP核建立modelsim仿真库完整解析

两个原因1、可能是你以前在用ModelSim仿真时没有用到xilinx里定制的IP核，即使你没加库文件也不会报错。2、如果以前ModelSim工程里也有调用过xilinx里定制的IP核没出错的话，那就你删除了上面说的文件引起的。我不知道xilinx的FPGA什么情况，但我知道Altera的FPGA，在做ModelSim仿真时如果调用了Altera的IP核，要在ModelSim工程中加入altera_mf.v（verilog仿真）的文件
ip核生成文件：（xilinx/altera 同）　　ip核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 edit－>language template->coregen 中找到verilog/vhdl 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块，仿真时该文件也要加入工程。 　2.调试方便。在 ise/quartus 中调用 modelsim仿真只能看到输入输出信 号，而对于设计的中间信号/变量，特别是ip核的内部信号/变量无法观测。而在modelsim中直接仿真可以观测设计中出现的任何信号/变量无和 ip 核内的任何信号/变量，这样我们设计的数据流向就可以很清楚的表示出来，还可以检测不同编程方式的处理效果，极大的方便了调试。

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